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    4,559 verilog vhdl trabajados encontrados, precios en USD
    Descifrado verilog Finalizado left

    A partir del codigo de cisfrado, que facilito. Implementar el codigo para descifrado. Para ello se Implementará el algoritmo de descifrado y comprobarás su funcionamiento usando el mensaje cifrado como entrada y la clave operativa (MSBF). Si la simulación es correcta, el resultado será un bloque de 64 bits a cero (u ocho bytes a cero). A continuación, descrifrarás el mensaje cifrado que faciltaré con la clave operativa asociada. Y colocarás el mensaje en claro en la caja de texto de la tarea. Se proporcionará todos los archivos, claves en privado. Se necesita para el día 2 de Noviembre, es una tarea de estudios, fácil. El tiempo estimado de trabajo es 30 min porque el codigo de cisfrado lo tengo, solo es modif...

    Ingeniería eléctrica Electrónica FPGA Mathlab y Mathematica Verilog / VHDL
    $30 (Avg Bid)
    $30 Oferta promedio
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    Diseño de una RAM VHDL Finalizado left

    Diseño de circuito VHDL en vivado

    Ingeniería eléctrica Electrónica Ingeniería FPGA Verilog / VHDL
    $20 (Avg Bid)
    $20 Oferta promedio
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    TFG sobre Diseño de un periférico VHDL. Finalizado left

    Buenas! Veréis tengo que hacer el TFG, tengo casi hecho el código en VHDL, pero yo creo XILINX me vacila. Tengo que entregarlo antes de diciembre y necesito que alguien me lo consiga a hacer porque yo solo no lo saco. Adjunto las entidades que tengo hechas, esta casi todo ya escrito solo me falta que me funcione, que no se por que, pero no me funciona.

    Electrónica Ingeniería Verilog / VHDL
    $10 - $37
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    Diseño de contador/ Cronometro en VHDL/Vivado Finalizado left

    Requiero un contador / cronometro que pueda contar de 0 a 99.9 segs, se debera entregar codigo fuente en VHDL / Vivado asi como resultado de simulaciones

    Diseño de circuitos Ingeniería eléctrica Electrónica Diseño PCB Verilog / VHDL
    $25 (Avg Bid)
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    Project for Miguel Angel R. Finalizado left

    Hola Miguel Angel, dominas VHDL? Si es así creo este proyecto para hablar contigo más ya que tengo un requerimiento pequeñito para resolver. Seguimos hablando por aquí.

    Assembler Programación en C Programación en C++ Python Ensamblador x86/x64
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    Project for Jorge Eduardo O. Finalizado left

    Hola Jorge Eduardo, como estamos? Dominas VHDL? Necesito un poco de ayuda con un pequeño proyecto. Seguimos hablando por aquí.

    ARM MySQL Ruby on Rails Swift Vue.js
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    Project for Jorge Luis V. Finalizado left

    Hi Jorge Luis, necesito ayuda con una cuestión de VHDL bastante sencilla si fuera posible. hablame por aquí y concretamos. es un poco urgente

    Ingeniería eléctrica Ingeniería Mathlab y Mathematica Neural Networks Python
    $10 - $10
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    Filtro de 3 bandas en vhdl Finalizado left

    Implemente un sistema de ecualización en tiempo real de tres bandas (bajos, medios y altos) en el FPGA de xilixn. Desarrolle los tres filtros necesarios para el ecualizador, los puede establecer en matlab o labview. Una vez definidos los coeficientes del filtro impleméntelos en el FPGA (a través de Matlab, Laview o Multisim). Se establece un bonus de 4 puntos para el grupo que lo implemente en código VHDL.

    Ingeniería eléctrica Electrónica LabVIEW Mathlab y Mathematica Verilog / VHDL
    $179 (Avg Bid)
    $179 Oferta promedio
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    Diseño FPGAs en VHDL Finalizado left

    Proyecto enfocado al diseño VHDL sobre FPGAS. Desarrollo de código y de bancos de pruebas, verificación del funcionamiento y resolución de algunas cuestiones. Tiene que estar terminado para el día 17 de diciembre. Se adjunta toda la descripción de lo que hay que hacer, así como unas plantillas para las soluciones y algunos bancos de pruebas.

    Ingeniería eléctrica Electrónica FPGA Diseño PCB Verilog / VHDL
    $35 (Avg Bid)
    $35 Oferta promedio
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    Programacion en Verilog -- 2 Finalizado left

    El objetivo general del presente proyecto consiste en la realización, verificación funcional y validación experimental de un microcontrolador sencillo basado en un subconjunto de la arquitectura del juego de instrucciones del RISC-V. El microcontrolador debe ser descrito en SystemVerilog de modo que sea sintetizable y pueda ser implementado en una FPGA Cyclone IV de Altera. Su validación experimental se realizará en el laboratorio mediante una aplicación sencilla propuesta por cada grupo que haga uso de los recursos hardware disponibles en el módulo de test. El proyecto abarca por tanto los aspectos de verificación funcional, descripción de hardware empleando SystemVerilog, implementación de un sistema digital integrado ...

    Ingeniería eléctrica Electrónica Ingeniería Microcontrolador Verilog / VHDL
    $185 (Avg Bid)
    $185 Oferta promedio
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    Programacion en Verilog Finalizado left

    El objetivo general del presente proyecto consiste en la realización, verificación funcional y validación experimental de un microcontrolador sencillo basado en un subconjunto de la arquitectura del juego de instrucciones del RISC-V. El microcontrolador debe ser descrito en SystemVerilog de modo que sea sintetizable y pueda ser implementado en una FPGA Cyclone IV de Altera. Su validación experimental se realizará en el laboratorio mediante una aplicación sencilla propuesta por cada grupo que haga uso de los recursos hardware disponibles en el módulo de test. El proyecto abarca por tanto los aspectos de verificación funcional, descripción de hardware empleando SystemVerilog, implementación de un sistema digital integrado ...

    Ingeniería eléctrica Electrónica Ingeniería Microcontrolador Verilog / VHDL
    $246 (Avg Bid)
    $246 Oferta promedio
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    Reloj, cronometro y alarma en VHDL para Basys2 Finalizado left

    Necesito hacer un programa en VHDL de un reloj (formato 24hs), con cronometro y con alarma. Cuando cambio a cada uno. no se debe perder la cuenta de la hora, cronometro o la alarma seteada. El reloj, la alarma y el cronometro se debe poder cargar/modificar manualmente. Detención y reinicio del cronometro. Cuando la hora del alarma coincida con el clock, prender los (o algún) led. Se deberá implementar algún tipo de barrido multiplexado para el uso de los 4 dígitos “7 segmentos”.

    Ingeniería eléctrica Electrónica Ingeniería PLC y SCADA Verilog / VHDL
    $180 (Avg Bid)
    $180 Oferta promedio
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    diseño digital en verilog Finalizado left

    necesito transmitir datos numericos entre la fpga nexys 3 y el pc, usando protocolo uart por medio del puerto serial uart, comunicacion asincrona, el proyecto requiere que se lea un numero en binario tomado desde los switchs que trae la tarjeta y muestre el valor ingresado en form...fpga nexys 3 y el pc, usando protocolo uart por medio del puerto serial uart, comunicacion asincrona, el proyecto requiere que se lea un numero en binario tomado desde los switchs que trae la tarjeta y muestre el valor ingresado en formato decimal en el lcd 7 segmentos, adicional a eso que esta información sea transmitida via puerto uart al computador. los entregarles son el codigo hecho en verilog,( make file, archivos.v ) ademas de brindar una breve explicacion del trabajo realizado. hay un p...

    Diseño digital Ingeniería eléctrica Electrónica FPGA Verilog / VHDL
    $33 / hr (Avg Bid)
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    FPGA, Microprocesadores 68k y PowerPC. Aviónica, equipos embarcados. Finalizado left

    Necesito para nuestro equipo de 15 ingenieros incorporar dos nuevos ingenieros con ilusión, cierta experiencia y conocimientos en VHDL/Verilog y microprocesadores. Es trabajo a tiempo completo y con estabilidad (2 años). Ubicación: Sevilla y Albacete. Uno en cada sitio.

    Electrónica Ingeniería Verilog / VHDL
    $24560 - $61400
    $24560 - $61400
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    Desarrollar software Finalizado left

    Modificaciones y rutinas extras para- gestión de dispositivos procesado de imágenes video / foto reducción de tiempo de procesado Ubicación Tres Cantos, Madrid Conocimientos de FPGAs / VHDL un plus trabajo a realizar en Abril 2017

    PHP Arquitectura de software
    $18 / hr (Avg Bid)
    $18 / hr Oferta promedio
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    Control PID lenguaje VHDL tarjeta Basys 2 Finalizado left

    Controlar la velocidad de un motor mediante PID usando encoder, en lenguaje VHDL para la tarjeta Basys 2 Spartan 3.

    Programación Verilog / VHDL
    $519 (Avg Bid)
    $519 Oferta promedio
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    Programar VHDL Basys 2 Finalizado left

    Ascensor 4 pisos, mediante una targeta basys 2 en una spartan 3e

    Verilog / VHDL
    $145 (Avg Bid)
    $145 Oferta promedio
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    Manual tecnico para el arranque tarjeta nexys 2 vhdl con spartan 3E Finalizado left

    necesito realizar proyectos en la tarjeta Nexys 2 vhdl del fabricante que tiene el procesador spartan 3E de xilinx practicamente lo que busco es un manual tecnico de como descargar los softwares necesarios para el trabajo, describir paso a paso de como realizar un programa utilizando el puerto vga de la tarjeta , en concreto un programa completo basado VHDL que me permita con este programa piloto modificarlo para generar otros programas  basados en el puerto VGA  

    Ingeniería industrial Palm Programación Arquitectura de software Desarrollo de software
    $184 (Avg Bid)
    $184 Oferta promedio
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    programador vhdl para tarea dificultad media-baja. Remunerada y muy urgente Finalizado left

    Realiza un circuito básico de PWM donde el tiempo en alto pueda modificarse en pasos de 10%. Simula el circuito y comprueba su funcionamiento. Deben verse varias consignas, compronado que la anchura de la salida es la correcta. Para este apartado puedes realizar una compilación funcional. ? Cambiando el tipo de compilación a no-funcional, compila el diseño eligiendo el dispositivo FLEX10KRC240-2. Utiliza las herramientas de MaxPlusII para obtener la frecuencia máxima de trabajo a la que puede funcionar el sistema. Mirando la información que aparece en el report file (fichero .rpt), indica el porcentaje de recursos lógicos que ocupa tu diseño. ? Escribe los resultados en un documento y mándaselo al profesor, junto con un archivo...

    Programación en C Programación en C++ FPGA LabVIEW Verilog / VHDL
    $307 (Avg Bid)
    $307 Oferta promedio
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    TAREA FACIL VHDL REMUNERADA , 606411904, 620623276 Finalizado left

    Particular busca urgente programador para tarea REMUNERADA en vhdl (facililla). Se trata de una práctica de 3º de telecomunicaciones para entregar en 10 días. Texto tarea: Realiza un circuito básico de PWM donde el tiempo en alto pueda modificarse en pasos de 10%. Simula el circuito y comprueba su funcionamiento. Deben verse varias consignas, compronado que la anchura de la salida es la correcta. Para este apartado puedes realizar una compilación funcional. ● Cambiando el tipo de compilación a no-funcional, compila el diseño eligiendo el dispositivo FLEX10KRC240-2. Utiliza las herramientas de MaxPlusII para obtener la frecuencia máxima de trabajo a la que puede funcionar el sistema. Mirando la información que apar...

    Arquitectura de software Verilog / VHDL
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    Programar un juego VHDL Finalizado left

    Soy de colombia Programar un juego llamado simon dice En VHDL y en el programa llamado Xilinx Simón dice Colores  El juego Simón dice colores es un juego de memoria donde el jugador deberá seguir la secuencia de colores que “Simón”  aleatoriamente va generando.  cada uno asociado con un color (verde, amarillo, azul y  rojo). Cada acierto de la secuencia completa de colores por parte del jugador incrementa el nivel y Simón agrega un nuevo  color a la secuencia. El juego termina cuando el jugador se equivoque o cuando alcance el número máximo de niveles para  los que fue diseñado el juego, el cual en ningún caso deberá ser menor a 32 niveles. 

    Programación en C Programación en C++ FPGA LabVIEW Verilog / VHDL
    $307 (Avg Bid)
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    vhdl expert 4 días left

    I want Signal processing and VHDL(Quartus Application) expert.

    Ingeniería eléctrica Ingeniería FPGA Microcontrolador Verilog / VHDL
    $20 / hr (Avg Bid)
    $20 / hr Oferta promedio
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    5G RAN FPGA Design Finalizado left

    We have an internal project for 5G RAN FPGA design for DFE products: Skills: Job Description- Senior MTS RTL design 5G Product( 2 positions) · Candidate must have at least Bachelors or Masters EE - FPGA design experience (RTL Coding, comms, DFE(DPD, DUC, DDC, FFT, FIR, CFR) · Candidate must have verifiable experience for a minimum 6 years as a Verilog/System Verilog/ VHDL/RTL programmer with extensive Verification test bench development experience · Preferred prior project experience in 5G ORAN - RU/DU. DSP knowledge Matlab modeling is preferred. · eCPRI experience preferred . Special consideration will be given to those who have experience as 100G Ethernet or 10G Ethernet , IEEE 1588 · Knowledge of Queuing theory · To...

    Digital Signal Processing FPGA Coding MATLAB Radio Access Network Commissioning Verilog / VHDL
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    $20 / hr Oferta promedio
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    Create an IC Chip Design Document - Verilog -- 2 Finalizado left

    I want you to desgin an IC chip description document. I need you to understand the verilog design and create some design descriotions, describing its fucntions in detail. The chip design has 3 main blocks ADC, PMU and sensors. These 3 blocks contain the most important functions of this chip. Please bid if you are experienced in wrting technical design documents for chip desing in detail. Thanks!

    Diseño de circuitos Digital ASIC Coding Electrónica FPGA Verilog / VHDL
    $32 (Avg Bid)
    $32 Oferta promedio
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    Codificador e Detector de Erros - VHDL Finalizado left

    A presença de erros em dados digitais é um problema frequente em sistemas computacionais que lidam com transmissão e armazenamento de informação. Em alguns contextos, como o de computação aproximada, admite-se uma taxa ainda maior de erros para alcançar uma redução no consumo de energia. Nesses casos, torna-se imprescindível o controle de erro...controle de erros. Isto pode ser feito através do uso de códigos detectores (e corretores) de erros, que são capazes de detectar (e corrigir) a informação corrompida através de redundância inserida nos dados. Nesse projeto, o objetivo é gerar um codificador baseado em paridade e um detector de erros que avisa quando um...

    Ingeniería eléctrica Electrónica FPGA Microcontrolador Verilog / VHDL
    $86 (Avg Bid)
    $86 Oferta promedio
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    variable size matrix multiplication VHDL Vivado Finalizado left

    the task is to develop and implement on synthesizable matrix multiplier kernels the simulation result compare with the result of matlab , the test platform read the input buffer of matrix A and B, then generating the output C. If the result is 100% compared with the result of matlab, the data in output file" OutputC .txt" should all appear true, otherwise , the result is false

    Ingeniería eléctrica FPGA Mathlab y Mathematica Verilog / VHDL
    $186 (Avg Bid)
    $186 Oferta promedio
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    Create a I2C Master Testbench to communicate with Slave Finalizado left

    I have the code for I2C slave. I want help in writing the verilog code for I2C Master testbench to communicate with the given slave. It can send a few i2C write and read commands (with address, data, etc). I have attached the code for I2C slave alonside for your reference.

    Digital ASIC Coding Ingeniería eléctrica Electrónica FPGA Verilog / VHDL
    $70 (Avg Bid)
    $70 Oferta promedio
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    FPGA Design for Terasic board Finalizado left

    1.VHDL code for SPI master to send data to a GPU. project setup for the customer's terasic FPGA board. assignment. demonstration of contents via zoom meeting. I will try to complete the project before the specified end date.

    ASIC Programación en C FPGA FPGA Coding Verilog / VHDL
    $200 (Avg Bid)
    $200 Oferta promedio
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    Development of hardware accelerator for i2c interface Finalizado left

    Your job is to write verilog code for i2c communication and interface it with a processor. Take data from the slave through the accelerator and store it in a memory. Make the processor read the data from that memory and give its response. Now write that response data back to the slave.

    Arduino Ingeniería eléctrica Electrónica Microcontrolador Verilog / VHDL
    $103 (Avg Bid)
    $103 Oferta promedio
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    VHDL Project (Code + Report) Finalizado left

    Hello everyone, I have to do a project in vhdl language. I have a list of 10/15 projects from which I have to choose one. The to-do list is: 1) report on the work done; 2) source code (in VHDL or other languages); 3) any examples for the code. The report typically consists of: - An overview of the topic. - A description of the methodology followed to carry out the project highlighting what are thought to be the most interesting contributions of the work done. - A high-level description of the code (it doesn't matter to put all the listings) and any instructions for use and compilation. - A description of the results obtained (simulations, statistics, algorithm outputs). I want to add that's not urgent.

    Ingeniería eléctrica Ingeniería FPGA Mathlab y Mathematica Verilog / VHDL
    $187 (Avg Bid)
    $187 Oferta promedio
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    SOC Verification Finalizado left

    ...ARM Interconnects(AHB, APB), SPI, UART, I2C, DMA, Serial Flash, Security and Encryption. 3. Full chip SoC (C and SV based), Subsystem and Block/IP level verification. Test Bench generation with ability to run embedded C programs. Must have experience of 2-3 SoC verification. 4. Experience in HDL(Verilog, VHDL) and HVL(System Verilog, Specman) based functional verification. Experience in code coverage. 5. Experience in Verification methodologies(UVM, OVM and eRM). language simulation (Verilog-AMS, SystemVerilog). 7. Experience in Mentor, Cadence and Synopsys simulators. 8. Build automated Test bench and regression environments from a scratch. Should be able to write a test plan and generate test cases 9. Regression management and Verification Sign-off based o...

    Programación en C Ingeniería eléctrica Ingeniería Microcontrolador Verilog / VHDL
    $1562 (Avg Bid)
    $1562 Oferta promedio
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    Energy-Efficient Logarithmic Square Rooter for Error-Resilient Applications -- 2 Finalizado left

    I need Verilog code for Energy-Efficient Logarithmic Square Rooter. It should be done within 1-2 days maximum.

    Ingeniería FPGA Mathlab y Mathematica Verilog / VHDL
    $8 - $19
    $8 - $19
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    integer type matrix multiplication with variable size (Vivado,VHDL,matlab) Finalizado left

    the version of Vivado software is 2018.3. I could provide my project, I need someone to help modify my code to achieve correct function. the test data is produced by matlab, the correct result should the outputC file appear all true. it involves IP core and ram

    Ingeniería eléctrica FPGA Mathlab y Mathematica Verilog / VHDL
    $230 (Avg Bid)
    $230 Oferta promedio
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    USB 2.0 Protocol Verification using System Verilog Finalizado left

    I am looking to develop a Verification Code using System Verilog for USB 2.0 Protocol and also I want a verification plan for that . Kindly note that I want Complete TB code for all the components in Environment and also Test and Top instances as well . For any query/ or clarity ping me.

    Verilog / VHDL
    $202 (Avg Bid)
    $202 Oferta promedio
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    Conversion of project from Xilinx to Quartus Finalizado left

    A complete color sorter Machine Firmware needs to be converted into Intel Quartus Project, The project contains IP Cores as well as softcore processor and the verilog coding part, All these to be integrated as a single bit file and to be implemented it on a Cyclone V FPGA Board.

    Ingeniería eléctrica Electrónica FPGA Microcontrolador Verilog / VHDL
    $2260 (Avg Bid)
    $2260 Oferta promedio
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    Morse code encoder and decoder in VHDL Finalizado left

    We need a project done in Morse code encoder and decoder in VHDL. Our project contains 2 parts a transmitter and receiver. The transmitter part receives the text(ASCII) from the PC(user) via UART receiver and transmits the text to morse code encoder(converts text to morse code). The morse code pattern then is sent to an led. Dot(.) corresponds to LED on and dash(-) LED off. The receiver part has a photo diode which reads the blinking of the led(morse code) and data is transmits to Morse decoder where it is converted back to ASCII. The converted ASCII is then transmitted to end user PC for display. We have already designed the top level top level block diagram. we now need the source codes(entity and architecture) for the blocks and test benches for all blocks for simulation...

    Ingeniería eléctrica Electrónica FPGA Microcontrolador Verilog / VHDL
    $27 (Avg Bid)
    $27 Oferta promedio
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    STM32CubeIDE and VHDL quartus Finalizado left

    STM32 toolchain and also vhdl design with report describing the procedures

    Ingeniería eléctrica FPGA Microcontrolador STM32 Verilog / VHDL
    $37 (Avg Bid)
    $37 Oferta promedio
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    quartus and modulsim Finalizado left

    i want some vhdl coding simulating with test bench on modulsim and a report

    Altera Quartus Ingeniería eléctrica Ingeniería FPGA Verilog / VHDL
    $67 (Avg Bid)
    $67 Oferta promedio
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    FPGA Project Finalizado left

    I need to do simple FPGA project on Boolean Board (Real Digital). For example Tic Tac Toe game. software should be Vivado and programming should be done in Verilog.

    Ingeniería eléctrica Electrónica FPGA Microcontrolador Verilog / VHDL
    $20 / hr (Avg Bid)
    $20 / hr Oferta promedio
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    Need Electrical Engineer having VHDL knowledge Finalizado left

    This project requires basic knowledge of digital electronics and VHDL coding.

    Ingeniería eléctrica Electrónica Ingeniería Microcontrolador Verilog / VHDL
    $14 / hr (Avg Bid)
    $14 / hr Oferta promedio
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    Digital Electronics and VHDL Project Finalizado left

    Need someone expert in Digital Electronics and VHDL programming. More details will be shared in private chat.

    Ingeniería eléctrica Electrónica Ingeniería Microcontrolador Verilog / VHDL
    $21 - $69
    Sellado
    $21 - $69
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    Digital Electronics and VHDL -- 3 Finalizado left

    Need someone expert in Digital Electronics and VHDL programming. More details will be shared in private chat.

    Ingeniería eléctrica Electrónica Ingeniería Microcontrolador Verilog / VHDL
    $7 - $41
    Sellado
    $7 - $41
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    Digital Electronics and VHDL -- 2 Finalizado left

    Need someone expert in Digital Electronics and VHDL programming. More details will be shared in private chat.

    Ingeniería eléctrica Electrónica Ingeniería Microcontrolador Verilog / VHDL
    $7 - $41
    Sellado
    $7 - $41
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    Digital Electronics and VHDL Finalizado left

    Need someone expert in Digital Electronics and VHDL programming. More details will be shared in private chat.

    Ingeniería eléctrica Electrónica Ingeniería Microcontrolador Verilog / VHDL
    $7 - $34
    Sellado
    $7 - $34
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    Digital Electronics VHDL Program Finalizado left

    Digital Electronics VHDL Program

    Ingeniería eléctrica Electrónica Redacción médica Redacción de investigaciones Arquitectura de software
    $92 (Avg Bid)
    $92 Oferta promedio
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    Digital Electronic Proffessional required immediately Finalizado left

    Professional and proficient in the following areas Boolean Algebra and Logic Design  Number systems  Basic Theorems of Boolean Algebra  Canonical and Standard Forms  Logic Gate Implementations and Characteristics: ...Logic  Latches  Flip Flops  Finite-State Machine (FSM) Model  Synthesis and Analysis  Designing State Machines using State Diagrams  Designing State Machines using ASM (Algorithmic State Machine) Charts  State Minimisation, Optimisation and Timing. Hardware Description Languages (VHDL)  Combinatorial descriptions  Delta Delays  VHDL hierarchy (Entities, modules, instantiation)  Language constructs (conditional assignment, selected assignment)  Synchronous descriptions (processes, if, case)  VHDL test benches  Synthesis considerations

    Digital Electronics Ingeniería eléctrica Verilog / VHDL
    $15 (Avg Bid)
    $15 Oferta promedio
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    Ethernet RTL(Verilog) Tutor Finalizado left

    Explain and help understand Ethernet MAC/PHY RTL from github. Required: - Industry experience in digital/mixed-analog IP RTL design, preferably Ethernet IP. Meetings will be conducted via zoom/meets. Thank you!

    DDR3 (PCIe, board design/fpga) Digital ASIC Coding FPGA Coding Semiconductor Verilog / VHDL
    $568 (Avg Bid)
    $568 Oferta promedio
    8 ofertas
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    Verilog program to fpga Finalizado left

    Program on vivado (verilog), morse code. Binary for "BASYS 3" fpga, simulation, files...etc More details via chat

    AutoCAD FPGA Español Verilog / VHDL
    $43 (Avg Bid)
    $43 Oferta promedio
    8 ofertas
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    Conversion of C Project into Verilog for FPGA Implementation Finalizado left

    I need to implement an Ed25519 Algorithm in Verilog for FPGA implementation that can properly simulate on Xilinx Vivado Design Suite. The complete algorithm code is already available in C language and I want to convert it into Verilog. Link:

    Programación en C Programación en C++ FPGA Verilog / VHDL
    $235 (Avg Bid)
    $235 Oferta promedio
    7 ofertas
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    Extract critical path from Verilog netlist Finalizado left

    Given any Verilog netlist of a digital circuit in gate-level format, the code should extract critical path. Critical path is the longest path from input to output port. There could be multiple inputs/outputs in a given circuits. Critical path can be the longest path from any input to any output based on the connections in the circuit.

    Electrónica Ingeniería Java Python Verilog / VHDL
    $13 (Avg Bid)
    $13 Oferta promedio
    5 ofertas
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